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多內(nèi)核芯片將在市場(chǎng)中大展雄風(fēng)

發(fā)布日期:2022-07-14 點(diǎn)擊率:69

,多內(nèi)核處理器和并行架構(gòu)成為了行業(yè)的一個(gè)新熱點(diǎn),過(guò)去微處理器公司希望不斷提高時(shí)鐘頻率和提供越來(lái)越多的指令級(jí)并發(fā)率(ILP)來(lái)提高微處理器的性能。但這意味著在性能提高的同時(shí),伴隨而來(lái)的是越來(lái)越大的功耗和不斷上升的成本,讓這種方法讓芯片跑得更快很久以前就已經(jīng)開始得不償失。

DRAM讀寫可能要花費(fèi)200個(gè)時(shí)鐘周期,而一次浮點(diǎn)乘法經(jīng)常只需要4個(gè)時(shí)鐘周期就能實(shí)現(xiàn)。成本也不僅僅只用時(shí)間來(lái)衡量,使用本地寄存器的效率比讀寫全局存儲(chǔ)器高一個(gè)數(shù)量級(jí),而這對(duì)能耗有限制的環(huán)境來(lái)說(shuō)可能是一個(gè)關(guān)鍵。

數(shù)字信號(hào)處理器。這是有意的,因?yàn)閹П镜卮鎯?chǔ)器、乘加器和哈佛結(jié)構(gòu)的16位處理器非常傳統(tǒng)和易于編程。多內(nèi)核架構(gòu)的創(chuàng)新和力量是其互連交換結(jié)構(gòu)和編程模式:每個(gè)單元都有一個(gè)獨(dú)特的已獲專利的互連經(jīng)由一個(gè)雙緩沖接口對(duì)它進(jìn)行服務(wù),系統(tǒng)架構(gòu)設(shè)計(jì)師在軟件編譯時(shí)對(duì)它進(jìn)行精確配置。


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